株式会社エッチ・ディー・ラボ

回路設計エンジニア/月給35万円〜47万円+賞与支給実績6ヵ月分(別に業績賞与も有)/年休124日〜/私服OK

  • 正社員
  • 自己PRと職歴不要
  • 年収:600〜800万円 目安残業時間:30時間以内
  • 掲載終了予定日:2019.12.02
回路設計エンジニア/月給35万円〜47万円+賞与支給実績6ヵ月分(別に業績賞与も有)/年休124日〜/私服OK

この求人の特色アイコンの説明

  • 未経験歓迎
  • 学歴不問
  • 第二新卒OK
  • ベテランOK
  • 複数名採用
  • 完全週休2日
  • 休日120日
  • 賞与複数月
  • 上場企業
  • 転勤なし
  • 土日面接可
  • 面接1回

業界知名度抜群の「技術者がつくった技術者の為の会社」で
ノウハウもスキルも高年収も手に入れませんか?

HDL設計の黎明期から取り組み、文字通り回路設計の最前線で
実績を積み上げてきた私たち「エッチ・ディー・ラボ」。
当社に関連した数々の書籍、トレーニングを通して、
ご存知の方も多いのではないでしょうか。

今回募集するのは、回路設計エンジニアのポジション。
今までに積み上げてきたLSI設計の経験と知見を活かし、
さらなるレベルアップを“安心して”実現してほしいと思います。

そのために必要な「ハイスキルな直接取引案件」と
「仕事に集中できる働きやすさ」をご用意。
そして高い知識レベルを要求する分、
「業界トップクラスの高年収」も手にできる
環境づくりに力を入れていきます。

===========

「技術者がつくった技術者の会社」だからこそ実現する、
「エンジニアの働きやすさ」が自慢です。
★大手メーカー直接取引
★自社内業務メイン
★最先端分野へのチャレンジも全力支援
★著書多数・専門技術研修事業好調
★業界屈指のHDLへの知見・ノウハウ共有体制
★残業月30時間未満
★月給35万円〜+賞与支給実績6ヵ月分
★入社3年目で年収600万円も実現可

募集要項

株式会社エッチ・ディー・ラボが募集している求人の詳細です。

募集背景

HDLによるLSI設計の黎明期から取り組み、コンサルティングをベースに様々な開発プロジェクトに参画してきた当社。確かな実績と高い実力を背景に、社会的な影響力も大きい案件が多数寄せられています。そんな当社が今回募集するのは「将来のコアメンバー」。成長意欲旺盛な方からのご応募、お待ちしています!

仕事内容

【 電子回路開発における基本設計〜検証までの一連をお任せします 】
本社または大手メーカーの開発プロジェクト先にて、Verilog-HDLやVHDL、
Cなどの言語を用いたLSI設計(FPGA、ASIC)を手がけていただきます。
★もちろん、入社後まずは経験やスキル、適性に応じた工程・業務からお任せします

== プロジェクト例 ==
◆デジタル一眼レフカメラのC-MOSセンサー
◆LSIチップ(暗号処理用、携帯電話用、複写機用など)
◆医療機器(内視鏡システム)
などに携わっています。

●受託開発がメインです
セキュリティの関係で常駐での開発もありますが、
基本的には本社での受託開発(一部出張あり)が中心となります。
当社の規模の会社が、完全受託のスタイルで案件をご依頼いただけるのは、システムLSI設計の黎明期より最前線で取り組んできた実績と信頼、
そして確かな技術力があるからです。

●クライアントについて
国内の名だたる半導体・電機メーカーから直接ご依頼いただいています。
新製品開発や先進技術の研究・開発など、当社に寄せられる案件のほとんどが「ハイスキル」なのが特徴です。
注目エンジニアとしての「やりたい」を応援できる会社です!

代表の長谷川自身が元エンジニア(HDL設計の第一人者として、セミナーなどで講演を行っています)ということもあり、エンジニアそれぞれの希望にとても理解があります。実際に、ある研究所での基礎研究を希望したエンジニアをサポートするべく、その研究への出資を即決したこともあります。少数精鋭ならではの小回りの利く体制も当社の特長の一つ。ぜひあなたの希望も、積極的に発信してください!

注目オンもオフも充実の働きやすさを整えています!

自社内での受託開発が中心ということもあり、比較的ゆとりを持ってスケジュールを組める環境です。また、裁量労働制のため出勤退勤の調整がしやすいですし、その上で土日休み・残業月30時間未満と、ワークライフバランスも整っています。実際に、子育てに奮闘する“イクメン社員”も活躍しています!

身に付くスキル
・キャリアパス

【 電子回路設計のスペシャリストに 】
当社がご依頼いただく案件は、技術的にレベルの高いものが多いのが特徴です。さらに、業界の“教育機関”としての事業を展開していることもあり、そうしたハイレベルな技術・ノウハウを共有・標準化することも得意。実践と教育が備わった環境ですので、エンジニアとしての腕をスピーディに磨いていけます。そういう環境で活躍している先輩たちとの協働も、教訓に溢れたものになるはずです。

応募資格

◆HDL(Verilog HDL、VHDL)での電子回路設計経験をお持ちの方
※経験工程/プロジェクト規模不問
※デジタル/アナログ、FPGA/ASIC不問
※学歴不問

雇用形態

正社員

想定給与

≪年収600万円〜/入社3年目から!≫
月給35万円〜47万円+賞与(支給実績6ヵ月分)+決算賞与
※経験・能力を考慮して決定します
※試用期間3ヵ月(給与・待遇に差異なし)
※月給には月30時間分(4万9000円〜)の固定残業代を含みます/超過分は別途支給/詳細は入社時に説明いたします
実際の給与例

【 モデル年収 】
・年収420万円/30歳・経験3年
・年収640万円/40歳・経験10年
・年収710万円/50歳・経験4年

      

勤務時間

裁量労働制(1日のみなし労働時間:8時間)
※参考 9:00〜18:00(休憩1時間含む)

★「イクメン社員」も活躍中!
子どもの送り迎えや行事への参加など、
自身の裁量で上手に時間を調整して仕事もプライベートも
しっかり充実させてる「イクメン社員」も活躍中です!
残業について

残業平均月30時間未満
※裁量制と併せて、自分なりの働きやすさを考えながら
 取り組める環境です

勤務地

基本的には本社での勤務となります。
★UIターン歓迎≪転居を伴う転勤ナシ・引越し代支援アリ≫
【 本社 】神奈川県横浜市港北区新横浜3-17-6 イノテックビル10F
※スキルや習熟度合い、経験に応じて、
 メーカーのプロジェクト先での勤務となる場合があります。
 (プロジェクト先は東京23区・神奈川県が中心です)
交通・詳細

【 本社 】
・各線「新横浜駅」より徒歩7分

勤務地エリア

東京23区、神奈川県(横浜市、川崎市を除く)、横浜市、川崎市

休日休暇

= 年間休日124日 =
◆完全週休2日(土日)
◆祝日
◆夏季休暇
◆年末年始休暇
◆有給休暇
◆慶弔休暇
◆産前産後休暇
◆育児休暇

待遇・福利厚生

◆昇給年1回(4月)
◆賞与年2回(6月・12月/支給実績:6ヵ月分)
◆業績賞与年1回(4月/支給実績0.8ヵ月分)※業績による
◆社会保険完備
◆交通費全額支給
◆時間外手当
◆UIターン支援あり(引越し代補助、住宅斡旋)
◆私服勤務OK(基本的に自社内での勤務です/出張あり)
◆退職金制度

掲載終了予定日:2019.12.02

もっと知りたい!会社の素顔

募集要項だけでは伝わらない 会社の魅力をお伝えします。

取材担当者より

今回の取材では、代表の長谷川氏に直接お話を聞くことができた。同氏の著書を今まさに手に持っている方も少なくはないだろうし、同社のエンジニアやトレーナーが講師を務めるセミナーに参加したことがあるという方もいるだろう。日本屈指の技術者集団…それは決して誇張ではない。その上で、代表の長谷川氏に転職先としての魅力をお聞きした。「エンジニアがつくったエンジニアの会社ですので、働きやすい方だと思います。あと、自由度の高さにも自信がありますし、お給料もまあまあ高い方だと思います」。そう語る同氏の優しい笑顔が印象に残る。業界屈指の知名度を誇る同氏と同社。そのオフィスは意外なほどに明るく、社員同士の壁もない。誰しもが目指す一流の技術者への道。同社でならばそこに、緊張も不安も気負いもなしに踏み込める。今回の転職に、技術者としての成長を期すのならば、このチャンスをぜひものにしてほしい。

会社概要

株式会社エッチ・ディー・ラボの会社概要です。

事業内容

●私たちは、回路設計の総合コンサルティング会社です
ますます増大する高集積化、高速化、省電力化の要求で、
システムレベル・ツール、HDLツール、
合成ツールなどの先端EDA技術の導入は必須のものとなっています。
回路設計シーンでは今や一般的となったHDLの黎明期から取り組み、
国内屈指のノウハウと知見を蓄積してきた当社。
代表・長谷川が書いた『 VHDLによるハードウェア設計入門 』は、
初版から20年を超えてなお、回路設計の入門書・基準書として
版を重ねています。
回路設計のエキスパート集団として実現する、真の設計生産性、
設計品質の向上を獲得するための高度で柔軟な技術サービス。
そうしたハイレベルな仕事を通して、技術者としての腕を磨けるのが
転職先としての当社の特長です。

【 事業内容 】
◆回路設計の総合コンサルティング
・通信、画像処理に関するHDL設計、LSI・FPGA設計およびコンサルティング
・IP開発、LSI・FPGA設計トレーニング
※基本的には完全受託での案件をお請けしていますが、
 一部技術支援の案件もあります(派14-301691)

【 会社としての著作物 】
・LSI設計の基本 RTL設計スタイルガイド VHDL編
・LSI設計の基本 RTL設計スタイルガイド Verilog HDL編

【 主要取引先 】
ソニー株式会社、オリンパス株式会社、キヤノン株式会社、富士通株式会社、
株式会社東芝、三菱電機株式会社、パナソニック株式会社、日本電気株式会社(NEC)
など、他多数。※一部抜粋・順不同・敬称略

設立

1996年4月

従業員数

21名

資本金

3780万円

売上高

2億8945万円(2017年3月期実績)

代表者

代表取締役社長 長谷川 裕恭

代表者略歴/回路設計エンジニアとしていち早くHDLに着目し、キャリアを重ねる。1995年に初版が発行された『 VHDLによるハードウェア設計入門 』は、今なお現代回路設計の教科書として、多くのエンジニアに愛読されている。

応募について

選考プロセスをはじめ、応募時に必要な情報や連絡先を確認できます。

選考プロセス

  1. STEP01

    Web応募書類による書類選考 ★できるだけたくさんの方とお会いします

  2. STEP02

    面接(1回)★日程などは相談に応じます!ご就業中の方もご安心ください

  3. STEP03

    内定 ★できるだけスピーディな選考を心がけています!

==========
★まずはお気軽にご応募ください!
==========
当社でならば、業界のトップランナーとして活躍する技術者になれます。
案件、トレーニング、面倒見の良い先輩たちなど、
環境面もどうぞご心配なく。
だからこそ、まずはあなたと直接お会いして、
将来の展望やモノづくりへの情熱などをお聞きしたいと思います。
業界では有名な当社ですが、少数精鋭でオフィスの雰囲気もまあまあフランクです!
だから、面接にはどうか、リラックスしてお越しください!
あなたとお会いできるのを楽しみにしています。

==========
★希望があれば入社時期は調整します
==========
【type】の専用応募フォームからご応募ください。
◆書類選考に3営業日〜1週間程度お時間をいただいています
◆ご応募から内定までは2〜3週間程度を予定しています
◆面接日、入社日はご相談に応じます。ご就業中の方もご安心ください
◆結果については合否に関わらずご連絡します
※応募書類はご返却できませんので、予めご了承ください
※応募の秘密厳守します

ホームページ

株式会社エッチ・ディー・ラボhttp://www.hdlab.co.jp

連絡先

〒222-0033

神奈川県横浜市港北区新横浜3-17-6 イノテックビル10F

採用担当

TEL / 045-477-4315(代表)

掲載終了予定日:2019.12.02

転職活動・求人応募についてよくある質問

Q.なかなか求人への応募に踏み切れない場合、どうしたら良いでしょうか?

興味のある求人を見つけたら、早めのご応募をお勧めします。 応募後の面接は、企業の採用担当者や社員と直接話すことができる絶好のチャンス!
企業の雰囲気などを感じることで、より良い転職活動に繋がります。まずは企業との接点を持つことが大切です。

Q.応募資格を満たしていない場合、応募はできないのでしょうか?

企業により異なりますが、応募資格を満たしていない方が採用に至った事例も多数ございます
不安点は面接時に質問するか、応募前に企業へ確認することをお勧めします。その際には、求人ページ内にございます「連絡先」へお問合せください。

Q.すでに別の求人に応募し、選考が進んでいます。他にも気になる求人があるのですが、応募しても良いのでしょうか?

複数社へ同時に応募することに問題はございません。同時に複数社の選考を進めることで、効率的に転職活動が行えるだけでなく、
転職先企業の決定時に比較検討が可能となり、失敗しない転職へと繋がります
。複数内定の獲得を目指して、積極的に応募しましょう!

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この求人情報について

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